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數字后端工程師
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(高級/主管)芯片后端設計工程師時擎智能科技(上海)有限公司上海-浦東新區2-4萬/月04-10

學歷要求:本科|工作經驗:3-4年|公司性質:合資|公司規模:50-150人

崗位職責:1. 負責芯片設計布局規劃、布局布線;2. 時序收斂;3. 物理驗證;任職要求:1. 有55nm及以下工藝節點后端經驗;有28nm一下經驗者優先。2. 熟悉后端設計工具及流程;3. 熟悉時鐘樹綜合、靜態時序分析、時序收斂;4. 了解功耗分析及電源網絡分析;5. 熟悉工藝規則,熟練掌握物理驗證及修正;6. 熟悉Perl,Tcl腳本編程。7. 熟練運用EDA工具,有Innovus,Calibre,Star-RCXT,Virtuoso等工具使用經驗者優先。8. 碩士3年,或學士5年以上相關設計經驗;

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Senior Implementation Engineer新思科技(上海)Synopsys上海-長寧區3-5.5萬/月04-10

學歷要求:本科|工作經驗:3-4年|公司性質:外資(歐美)|公司規模:500-1000人

Job Description and Requirements At Synopsys, we’re at the heart of the innovations that change the way we work and play. Self-driving cars, Artificial Intelligence, The cloud, 5G, The Internet of Things. These breakthroughs are ushering in the Era of Smart Everything. And we’re powering it all with the world’s most advanced technologies for chip design and software security. If you share our passion for innovation, we want to meet you. Our Silicon IP business is all about integrating more capabilities into an SoC—faster. We offer the world’s broadest portfolio of silicon IP—predesigned blocks of logic, memory, interfaces, analog, security, and embedded processors. All to help customers integrate more capabilities, meet unique performance, power, and size requirements of their target applications and get differentiated products to market quickly with reduced risk.  Implementation Engineer Seeking a highly motivated and innovative physical implementation engineer with theoretical background in memory controller implementation. The successful candidate will be part of de Designware IP High Bandwidth Memory (HBM) Controller R&D team (or similar protocols), and will perform a key role in linking the front-end RTL design with the back-end physical implementation design.   The successful candidate will drive alignment between the RTL design team and physical design team. It will provide technical oversight to the physical design team on the physical implementation of the controller and technical guidance to the RTL design team on the creation of designs to meet every more demanding timing-closure challenges.   The candidate(s) will be strong in RTL synthesis, constraint generation/validation and timing analysis. They will be capable of generating sub-systems consisting of controller, PHY and SRAM. They will be capable of defining floorplans and pushing the design through front-end placement flows. The successful candidate will be very familiar with physical design. The successful candidate will be responsible for the handoff from RTL design to physical design and will be responsible for writing customer implementation guides. The candidate will work in a project and team-oriented environment with teams spread across multiple sites, worldwide.   Key Qualifications ·        Must have BSEE in EE with 8+ years of relevant experience or MSEE with 6+ years in design and implementation of IP cores and/or SOC ·        Must have experience in Synthesis flows and validating timing constrains ·        Must have experience in design/physical implementation of high frequency interfaces ·        Experience with scripting languages (eg. BASH/TCSH/PERL/PYTHON/TCL) ·        Experience with Verilog, VHDL and/or SystemVerilog ·        Experience with Perforce or similar revision control environment ·        Demonstrate understanding of PHY+CTRL(+SRAM) integration ·        Desired knowledge of one or more of protocols like HBM, DDR, PCIE, USB, MIPI-UFS/Unipro is a plus ·        Desired experience in design and physical implementation in high speed memory interfaces (HBM/DDRx) is a plus Desired skills   ·        Demonstrate good written and oral communication skills ·        Demonstrate good analysis, debug and problem-solving skills ·        Ability to resolve conflicts and maintain composure under pressure ·        Should be a team player with positive outlook and “can do” attitude   Inclusion and Diversity are important to us. Synopsys considers all applicants for employment without regard to race, color, religion, national origin, gender, sexual orientation, gender identity, age, military veteran status, or disability.

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數字后端設計工程師上海靈動微電子股份有限公司上海-浦東新區2-4萬/月04-10

學歷要求:本科|工作經驗:2年|公司性質:民營公司|公司規模:150-500人

崗位職責:1.負責SOC芯片、ASIC芯片從netlist到tape-out的全流程工作;2.能夠進行芯片布局、電源、時鐘的規劃,完成布局布線、時鐘樹綜合布線以及時序收斂;3.能夠開展DC綜合流程,能夠根據設計需要確認綜合過程中的設計約束;4.針對后端設計能夠進行時序分析,并從實現的角度優化芯片面積和功耗任職資格:1.1年以上物理設計實踐經驗,學士以上學歷、碩士尤佳;2.精通從門級網表到GDS的芯片設計流程;3.熟悉主流EDA廠家的PR/PV/signoff工具;4.熟練掌握Shell/TCL/Perl/Python或其它類似的腳本語言編程和建立自動化設計流程;5.具有成功量產芯片的設計經驗;6.具有14nm或者22nm設計經驗者優先;7.具有自我驅動和團隊合作精神,較強的口頭和書面交流能力。

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數字后端工程師上海賽米德半導體科技有限公司蘇州分公司蘇州-工業園區30-60萬/年04-10

學歷要求:本科|工作經驗:3-4年|公司性質:民營公司|公司規模:50-150人

1、負責ASIC&SoC Top或關鍵block 的Netlist 到GDS T/O的 P&R實現。2、結合系統要求和設計人員支持,完成高質量的FloorPlan、CTS等工作。3、完成面積優化、Routing、時序分析與收斂、IR 分析等工作,完成signoff 與T/O。4、參與Flow設置、P&R階段的項目管理、Job分配等。Team Leader 機會。任職要求:1、熟悉linux 開發環境,熟悉常用linux 下文本編輯工具,熟悉Tcl/Perl 等腳本語言。2、熟悉Innovus, PrimeTime,Laker等EDA工具。精通CTS、時序修復等。。4、本科及以上學歷,3年及以上芯片后端工作經驗。5、40nm及更先進工藝經驗、SOC Top 的芯片流片經驗、熟悉DDR\PCIe\Serdes等IP經驗者優先。6、認真的工作態度、良好的工作積極性、責任心。邏輯思維能,良好的文檔撰寫能力。 公司提供有完善的福利待遇和完善的培訓體系以及充足的個人發展空間!鞍l送簡歷時,請注明來自51job,請勿重復投遞簡歷”  期待您的加入!

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數字后端工程師- 成都(J10370)晶晨半導體(上海)股份有限公司成都1.5-3萬/月04-10

學歷要求:本科|工作經驗:3-4年|公司性質:上市公司|公司規模:500-1000人

工作職責:負責整個芯片或模塊的布局布線設計, 包括布局規劃, 布局布線, 時鐘樹生成, 時序優化和收斂, DFT, 以及 DRC/LVS物理驗證.任職資格:1. 電子工程或微電子專業本科及以上學歷;2. 至少5年以上大規模集成電路芯片后端設計經驗;3. 具有使用Synopsys 或Cadence 設計工具的相關經驗;4. 熟悉90nm及以下工藝芯片設計,熟悉12nm更佳;5. 良好溝通能力和團隊精神。

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資深后端研發工程師/專家 服務器性能調優向網易集團廣州-天河區2.5-5萬/月04-10

學歷要求:本科|工作經驗:3-4年|公司性質:上市公司|公司規模:10000人以上

質量保障中心服務器性能調優團隊致力于在游戲質量保障和效率提升等領域尋求技術上的探索與突破,在深度性能優化、智能AI診斷系統等多個服務器壓力測試方向持續推出業界領先的產品和解決方案。您可以:- 加入國內最***的游戲研發團隊,享受規范和優質的培訓體系,獲得飛速成長的機會;- 主導研發業內最先進的壓力測試平臺,推進行業技術革新,順手收獲大票專利;- 深度挖掘服務器性能問題。通過測試工具的開發,流程進度的控制,幫助研發團隊創造最穩定的服務器系統;- 鉆研各種外掛技術并研究出一一擊破的戰術,設計產品性能、壓力測試方案,為游戲研發制定更高標準。職位要求:我們希望您符合以下描述:- 計算機或相關專業,本科及以上學歷;- 具備扎實的計算機基礎,熟悉C++/java/python等至少一門編程語言,深入理解數據結構、算法、操作系統和網絡等知識;- 具備縝密的邏輯思維能力和強烈的求知欲,能夠快速學習新的知識;- 做事積極主動,執行力強,能推動問題解決,有良好的團隊精神和溝通能力。具備以下條件尤佳:- 有服務器后臺開發經驗,熟悉各種高性能服務器技術;- 有豐富的軟件開發經驗,為多個開源軟件項目貢獻代碼;- 對算法有深入鉆研,有科研、重要期刊或會議Paper,在程序設計大賽獲獎;- 熱愛游戲,樂于鉆研游戲設定,對游戲有深入理解。

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NVIDIA熱招 Physical Design Engineer (后端物理設計)英偉達半導體(上海)有限公司(NVIDIA)北京04-09

學歷要求:本科|工作經驗:1年|公司性質:外資(歐美)|公司規模:10000人以上

部門簡介: 上海VLSI Physical Design 部門成立于2005年, 在過去的15年里,我們成功地參與并設計了NVIDIA發布的所有產品。我們使用的是最前沿的生產工藝,最先進的EDA工具以及最復雜的設計流程。致力于最先進的產品設計,挑戰技術之巔是我們一貫的追求。 【你會做些什么】 負責NVIDIA (英偉達)公司所有芯片(包括GeForce,Tegra,Tesla,Quadro等系列)的物理設計及其實現(Netlist to GDSII), 以及流程開發(Flow development)。 致力于: 芯片規劃及布局, 頂層設計到底層模塊的劃分 電源/時鐘分布及規劃 布局布線 (包含從頂層設計以及底層模塊的全部內容) 靜態時序/功耗/噪聲/可制造性優化及分析 物理驗證 流程自動化以及回歸測試 與EDA提供商合作進行工具評估和改進 開發內部工具和解決方案 【我們想要看到這樣的你】 微電子, 電子工程及相關專業碩士生 有相關課程背景:集成電路設計, 數字電路設計, 半導體器件 有以下知識:芯片設計, 布局布線 有數字芯片項目設計經驗或者使用ASIC設計流程的經驗優先 有EDA工具(布局布線,時序分析,電路仿真, 版圖設計等)的使用經驗優先 有使用Perl,Tcl,Python和Shell等語言編寫腳本的能力優先

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數字后端設計(北京)中科芯集成電路有限公司北京30-40萬/年03-04

學歷要求:碩士|工作經驗:5-7年|公司性質:國企|公司規模:1000-5000人

崗位職責:1、根據工作安排及相關要求,建立對應的設計庫及環境;2、負責從netlist到GDS signoff的后端設計工作(布局、電源規劃、CTS、布線、時序修正、IR分析、串擾、天線效應修復、寄生提取、物理驗證等);3、配合前端設計人員,完成項目后期工作,如性能優化、版圖整合;4、負責項目相關文檔的撰寫,負責設計數據的安全以及數據的準確性。 任職資格:1、熟悉使用一種后端主流EDA工具(ICC、Encounter);2、熟悉encouter設計工具,掌握低功耗、多電壓源設計和實現;3、熟悉主流腳本語言;4、有模擬IC版圖相關經驗優先;5、有流片經驗優先;6、主動性強,有責任心,做事認真仔細,良好的團隊合作精神。

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后端設計工程師(微電子公司)中國船舶重工集團公司第七0九研究所武漢20-40萬/年04-08

學歷要求:碩士|工作經驗:5-7年|公司性質:事業單位|公司規模:1000-5000人

工作職責:1、負責ASIC芯片后端設計、完成從網表至GDSII設計;2、進行版圖設計相關工作:數字PR、電源網絡設計、時序收斂、功耗分析、物理驗證等;3、負責后端外協項目對外銜接與把控工作;4、負責生成和維護后端相關文檔及報告。任職資格:1、微電子/計算機/電子/自動化等相關專業,碩士研究生以上學歷;2、5年以上后端設計相關工作經驗,3次以上流片經驗,28nm及以上工藝節點設計流片經驗者優先;3、熟悉晶圓廠提供的各種物理庫文件;4、熟悉后端布局布線、時鐘樹綜合、寄生參數提取、時序分析、形式化驗證、功耗分析等流程;5、熟悉Tcl腳本語言;6、具有強烈自我驅動意識和奮斗精神;7、薪酬面議,參考本地區同行業薪酬水平。

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Backend Design Engineer 后端設計工程師豪威科技(上海)有限公司上海-浦東新區04-06

學歷要求:本科|工作經驗:2年|公司性質:外資(歐美)|公司規模:1000-5000人

職位概述:負責芯片的物理設計包括布局布線以及物理驗證等工作職責:1. 整芯片的物理設計流片包括布局規劃,電源分布,布線,電壓降分析,時序收斂,串擾分析和物理驗證等2. 負責模塊級的物理設計工作3. 幫助部門優化設計流程和設計方法等職位要求:1. 相關專業本科以上學歷2. 兩年以上相關工作經驗3. 熟悉目前業界主流的物理設計方法和工具4. 有實際流片經驗或是有良好腳本編寫能力優先5. 具有良好的團隊精神和溝通技巧

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芯片后端設計工程師3504北京展訊高科通信技術有限公司北京-海淀區2-4萬/月03-31

學歷要求:碩士|工作經驗:3-4年|公司性質:國企|公司規模:1000-5000人

崗位職責:1. ASIC IC 設計芯片后端工程師從RTL2GDSII2. 布局布線,電源網絡設計,時序收斂,功耗分析,物理驗證等 任職資格:碩士學位,微電子,計算機相關專業,超過3年以上的芯片后端實踐經驗1. 具有復雜數字后端設計的RTL2GDS工作經驗2. 具備完整的芯片Tapeout經驗,后端布局規劃(模塊級或全芯片級)3. 熟悉STA靜態時序分析及低功耗設計與分析4. 物理驗證能力LVS/DRC/ERC/LVL/RTO/ANT/LUP5. 具備熟練的腳本技能(比如TCL,Perl,Python,及后端設計flow)6. 熟練Cadence P&R后端工具Innovus 40/28/22/12 / 7nm工藝節點,從Netlist到GDSII的整個后端流程的經驗(Floorplaning, Power Planning, Placement & Optimization, CTS,Routing,ECO,RC/Spef,STA)7. 熟悉關于OCV,LVF,MM/MC 優化和多功率設計的工作知識8. 了解CPU,DDR,Clock Structure,及基本數字邏輯9. 良好的溝通能力,英語讀寫順暢

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數字IC后端工程師南京德睿智芯電子科技有限公司南京-浦口區1.2-2.5萬/月04-10

學歷要求:碩士|工作經驗:3-4年|公司性質:民營公司|公司規模:150-500人

1、負責數字IC的后端物理實現,包括DC綜合、APR、功耗分析、串擾分析等工作2、負責芯片級的版圖布局規劃與設計,包括ESD、IO PAD、數字IP、模擬IP的Merge等工作;3、負責芯片級的物理驗證及tapout相關工作;4、負責數字/模擬版圖設計的EDA環境建設與維護。職位要求:1、電路與系統、微電子等相關專業,碩士以上學歷,具有3年以上數字后端工作經驗;2、精通基于Cadence或synopsys后端設計流程,具備fab tapout交付工作經驗;3、熟練閱讀專業英文資料,具備良好的英文讀、寫能力;4、工作態度嚴謹,具有良好的人際溝通能力、團隊合作精神!锓窍嚓P專業者勿投!

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IC后端設計師上海道生物聯技術有限公司武漢-東湖新技術產業開發區1.5-3.5萬/月04-10

學歷要求:本科|工作經驗:3-4年|公司性質:民營公司|公司規模:少于50人

崗位職責: 負責整個芯片或模塊的布局布線設計, 包括布局規劃, 布局布線, 時鐘樹生成, 時序優化和收斂, 以及 DRC/LVS物理驗證.   職位要求: 1. 電子工程或微電子專業本科及以上學歷; 2. 至少3年以上大規模集成電路芯片后端設計經驗; 3. 具有使用Synopsys 或Cadence 設計工具的相關經驗; 4. 熟悉90nm及以下工藝芯片設計; 5. 良好溝通能力和團隊精神。

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數字后端工程師(J11539)上海聯影醫療科技股份有限公司上海-嘉定區1.5-3萬/月04-10

學歷要求:本科|工作經驗:5-7年|公司性質:民營公司|公司規模:5000-10000人

工作職責:崗位職責:1.負責RTL to GDS物理設計2.SOS布局,placement,CTS等3.后端低功耗設計任職資格:崗位需求:1、電子、微電子、通信等相關專業本科及以上學歷,具備數電、模電、半導體相關基本知識。2、掌握數目混合芯片頂層物理設計。。3、熟練掌握40nm及一下UPF/CPF的低功耗物理設計流程4、熟練使用相關EDA工具5、熟練掌握tcl,perl等一門腳本語言

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數字后端工程師芯翼信息科技(上海)有限公司上海-浦東新區20-60萬/年04-10

學歷要求:本科|工作經驗:1年|公司性質:民營公司|公司規模:50-150人

  1、數字后端pr,包括  Floor-plan, power planning, Place, CTS, Route, starrc, eco;  2、需要執行物理版圖驗證,包括DRC LVS  ANT;  3、分析和優化IR drop,以及對整個chip的全局把控,面積優化;  4、熟悉后端sign off條件,進行靜態時序分析,修復setup、hold 時序違例;  5、熟悉時鐘、復位結構的設計;  6、熟悉低功耗設計流程優先;    任職需求:  1、一年以上并有 SOC 項目tape out的數字后端經驗;  2、有相應的腳本基礎,如makefile、perl、TCL or csh/tcsh;  3、能夠和前端設計一起優化時序、面積、功耗,尤其是靜態時序分析;  4、有Synopsys/Cadence的工具以及flow的經驗( Innovus / IC-Compiler);  5、良好的問題分析處理能力。

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數字后端設計工程師深圳智微電子科技有限公司深圳-南山區1.5-3萬/月04-10

學歷要求:本科|工作經驗:2年|公司性質:民營公司|公司規模:50-150人

1.電子、微電子、通信相關專業,本科及以上學歷,碩士優先,工作經驗不限;2.具備后端物理實現的技能,熟悉后端設計流程及工具;3.熟悉EDA工具(電路版圖Virtuoso、布局布線innovus/icc等),熟悉數字電路IC設計流程;4.熟悉數字邏輯基本的時序等概念;5.熟悉linux操作系統,***掌握tcl/perl/python其中一種腳本編程語言6.工作認真細致,具有良好的溝通能力及團隊精神。

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數字后端工程師景略半導體(上海)有限公司上海0.8-1.8萬/月04-10

學歷要求:本科|工作經驗:2年|公司性質:外資(歐美)|公司規模:50-150人

1.       與前端工程師協作完成block級和全芯片級別的物理實現和時序收斂2.       參與整個后端設計流程,包括floorplan/Placement/CTS/Routing/PV3.       進行項目后端電源網絡的設計和實現。任職要求:1.       對于時序分析和約束,功耗優化,物理驗證,電源完整性有較深入的理解。2.       熟悉后端設計流程。3.       熟悉后端實現工具并具備腳本編寫與調試能力。

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數字后端設計工程師(物理實現)合肥智芯半導體有限公司蘇州-姑蘇區1.2-2萬/月04-10

學歷要求:本科|工作經驗:3-4年|公司性質:民營公司|公司規模:50-150人

- 3-5年數字后端設計經驗;- 熟悉半導體基本知識、原理,以及數字后端的基本知識,了解消費類芯片SOC的物理實現,熟悉RTL2GDS流程;- 熟悉掌握/操作EDA工具,深入理解邏輯綜合、floorplan、布局布線、時序分析、功耗分析等;- 熟練掌握物理驗證, LVS/DRC 等;- 良好的腳本能力 Perl/Tcl/Python;

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數字后端設計工程師無錫麟力科技有限公司無錫-錫山區1-1.5萬/月04-10

學歷要求:本科|工作經驗:2年|公司性質:民營公司|公司規模:50-150人

1、利用EDA工具實現數字模塊從netlist到GDS的數字后端設計工作;2、負責數字電路的物理實現和優化,包括Synthesis、Floorplanning、place&route、timing signoff、physical verification、Low Power、STA等;3、與前端設計人員合作,優化時序面積、功耗,并執行靜態時序分析4、良好的溝通能力任職要求:1、微電子或電子工程相關專業,2年以上數字后端電路設計經驗,具備項目量產經驗; 2、精通基于Cadence后端設計flow或synopsys后端P&R設計流程,在Synopsys Cadence自動物理實現工具和流程(IC-Compiler Astro Innovus Star-RCX等)方面經驗豐富。3、能獨立負責數字設計的后端工作,包括DC DFT Floorplan Place CTS Route signoff STA等等。4、熟練掌握靜態時序分析(PrimeTime),并進行setup/hold修正。5、熟練掌握Virtuoso,能結合模擬版圖,優化和驗證流片版圖(包括RC提取,ECO,DRC,LVS)

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數字IC(前端/后端)設計工程師蘇州珂晶達電子有限公司蘇州-工業園區25-50萬/年04-10

學歷要求:本科|工作經驗:2年|公司性質:民營公司|公司規模:少于50人

1. 根據系統功能要求進行數字系統及模塊代碼設計、驗證、綜合和時序分析,完成相應設計報告;2. 對相關IP進行模型驗證,完成芯片集成,對數;旌闲酒w進行仿真驗證,完成相應驗證報告;3. 進行FPGA原型驗證或指導測試工程師進行PFGA相關驗證;4. 進行代碼綜合、邏輯檢查、時序檢查、DFT設計、布局布線等數字后端流程及物理驗證工作,并完成后仿真驗證5. 制定相應測試方案,協助測試工程師搭建測試平臺,負責電路的測試驗證和debug調試,完成相關測試數據整理、分析和報告。任職要求:1. 微電子、通信、集成電路設計、電子工程等相關專業,本科以上學歷3年以上相關工作經驗或碩士以上學歷1年以上相關工作經驗;2. 掌握數字集成電路設計方法、工具,了解設計流程、設計規范要求;3. 熟悉數字通信和接口相關協議者優先;4. 熟悉數字驗證方法學或能完成小規模數字設計前后端全流程者優先;5. 有實際設計和流片、測試經驗者優先;6. 較好的溝通、表達能力和團隊協作精神。

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